diff --git a/projet_etu.circ b/projet_etu.circ
index 2cfff7f..caa3878 100644
--- a/projet_etu.circ
+++ b/projet_etu.circ
@@ -41,6 +41,7 @@
   </lib>
   <lib desc="#Gates" name="1">
     <tool name="NOT Gate">
+      <a name="facing" val="north"/>
       <a name="size" val="20"/>
     </tool>
     <tool name="AND Gate">
@@ -48,7 +49,6 @@
       <a name="size" val="30"/>
     </tool>
     <tool name="OR Gate">
-      <a name="facing" val="south"/>
       <a name="size" val="30"/>
       <a name="width" val="16"/>
     </tool>
@@ -2266,13 +2266,30 @@
     <comp lib="0" loc="(620,460)" name="Constant">
       <a name="width" val="16"/>
     </comp>
+    <comp lib="0" loc="(640,510)" name="Probe">
+      <a name="appearance" val="classic"/>
+      <a name="facing" val="south"/>
+      <a name="radix" val="10signed"/>
+    </comp>
+    <comp lib="0" loc="(720,550)" name="Probe">
+      <a name="appearance" val="classic"/>
+      <a name="facing" val="south"/>
+      <a name="radix" val="10signed"/>
+    </comp>
+    <comp lib="0" loc="(730,230)" name="Probe">
+      <a name="appearance" val="classic"/>
+      <a name="facing" val="south"/>
+      <a name="label" val="OutMem"/>
+      <a name="labelloc" val="north"/>
+      <a name="radix" val="10signed"/>
+    </comp>
     <comp lib="0" loc="(880,570)" name="Probe">
       <a name="appearance" val="classic"/>
       <a name="facing" val="south"/>
       <a name="labelloc" val="south"/>
       <a name="radix" val="10signed"/>
     </comp>
-    <comp lib="1" loc="(430,370)" name="NOT Gate">
+    <comp lib="1" loc="(400,380)" name="NOT Gate">
       <a name="facing" val="north"/>
       <a name="size" val="20"/>
     </comp>
@@ -2322,8 +2339,7 @@
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-    <wire from="(430,390)" to="(430,410)"/>
+    <wire from="(430,310)" to="(430,410)"/>
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     <wire from="(430,610)" to="(690,610)"/>
@@ -2338,16 +2354,19 @@
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@@ -2622,7 +2641,7 @@
     <comp lib="0" loc="(350,220)" name="Probe">
       <a name="appearance" val="classic"/>
       <a name="facing" val="south"/>
-      <a name="radix" val="10signed"/>
+      <a name="radix" val="10unsigned"/>
     </comp>
     <comp lib="0" loc="(480,330)" name="Probe">
       <a name="appearance" val="classic"/>
@@ -2653,6 +2672,11 @@
     <comp lib="0" loc="(540,210)" name="Constant">
       <a name="width" val="8"/>
     </comp>
+    <comp lib="0" loc="(570,150)" name="Probe">
+      <a name="appearance" val="classic"/>
+      <a name="facing" val="south"/>
+      <a name="radix" val="10signed"/>
+    </comp>
     <comp lib="0" loc="(770,140)" name="Probe">
       <a name="appearance" val="classic"/>
       <a name="facing" val="south"/>
@@ -2669,9 +2693,6 @@
     <comp lib="1" loc="(250,250)" name="OR Gate">
       <a name="size" val="30"/>
     </comp>
-    <comp lib="1" loc="(330,260)" name="AND Gate">
-      <a name="size" val="30"/>
-    </comp>
     <comp lib="2" loc="(1070,190)" name="Multiplexer">
       <a name="width" val="8"/>
     </comp>
@@ -2687,18 +2708,29 @@
     <comp lib="3" loc="(950,170)" name="Comparator"/>
     <comp lib="4" loc="(1100,290)" name="RAM">
       <a name="appearance" val="logisim_evolution"/>
+      <a name="asyncread" val="true"/>
       <a name="clearpin" val="true"/>
       <a name="dataWidth" val="16"/>
+      <a name="trigger" val="falling"/>
     </comp>
     <comp lib="4" loc="(380,190)" name="Register">
       <a name="appearance" val="logisim_evolution"/>
+      <a name="trigger" val="falling"/>
     </comp>
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+    <wire from="(1040,350)" to="(1040,380)"/>
+    <wire from="(1040,350)" to="(1100,350)"/>
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+    <wire from="(1060,360)" to="(1100,360)"/>
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@@ -2706,7 +2738,7 @@
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@@ -2726,51 +2758,45 @@
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