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Simon Pribylski
2024-12-11 17:12:38 +01:00
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commit 0f87d219db
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52
projet_etu.circ
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@@ -44,7 +44,7 @@
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</tool>
<tool name="AND Gate">
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<tool name="OR Gate">
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</appear>
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<comp lib="0" loc="(150,60)" name="Pin">
<a name="appearance" val="classic"/>
<a name="label" val="PC"/>
<a name="width" val="16"/>
</comp>
<comp lib="0" loc="(350,80)" name="Pin">
@@ -1174,22 +1176,30 @@
<comp lib="1" loc="(220,170)" name="XOR Gate">
<a name="size" val="30"/>
</comp>
<comp lib="1" loc="(280,110)" name="AND Gate">
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<a name="negate1" val="true"/>
<a name="size" val="30"/>
</comp>
<comp lib="2" loc="(300,80)" name="Multiplexer">
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</comp>
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<circuit name="GetCst">